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基于VHDL语言的数字频率计设计
引用本文:林晓焕,林刚.基于VHDL语言的数字频率计设计[J].西安工程科技学院学报,2005,19(3):321-324.
作者姓名:林晓焕  林刚
作者单位:[1]西安工程科技学院,电信学院,陕西西安710048 [2]中国飞行试验研究院,陕西西安710089
摘    要:传统数字频率计由于在高频段受基准时钟频率的限制,其测频精度受到很大的限制.本文应用EDA技术,很好的解决了这一问题.文中论述了数字频率计的设计原理、开发环境、设计步骤、设计框架,以及应用VHDL语言对系统的实现方法,说明了各模块和系统输入输出信号的功用.应用MAX+PLUSⅡ对系统进行仿真验证,结果表明所设计的数字频率计不但测频精度达到较高的水平,而且能够实现连续不间断测频.

关 键 词:数字频率计  VHDL语言  可编辑逻辑器件(FPGA)
文章编号:1671-850X(2005)03-0321-04
修稿时间:2004年12月15

The design of digital cymometer based on VHDL
LIN Xiao-huan,LIN Gang.College of Electronics & Information,XAUEST,Xi'an ,China,.China Flight Test Establishment,Xi'an ,China.The design of digital cymometer based on VHDL[J].Journal of Xi an University of Engineering Science and Technology,2005,19(3):321-324.
Authors:LIN Xiao-huan  LIN GangCollege of Electronics & Information  XAUEST  Xi'an  China  China Flight Test Establishment  Xi'an  China
Institution:LIN Xiao-huan~1,LIN Gang~21.College of Electronics & Information,XAUEST,Xi'an 710048,China,2.China Flight Test Establishment,Xi'an 710089,China)
Abstract:
Keywords:VHDL  digital cymometer  FPGA  
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