| 可重构算子阵列的结构和建模 |
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| 引用本文： | 雍珊珊,王新安,曹颖,张芳妮,史小龙,谢峥.可重构算子阵列的结构和建模[J].北京大学学报(自然科学版),2014,50(4):761-767. |
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| 作者姓名： | 雍珊珊 王新安 曹颖 张芳妮 史小龙 谢峥 |
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| 作者单位： | 北京大学深圳研究生院集成微系统科学工程与应用重点实验室,深圳,518055;北京大学深圳研究生院集成微系统科学工程与应用重点实验室,深圳,518055;北京大学深圳研究生院集成微系统科学工程与应用重点实验室,深圳,518055;北京大学深圳研究生院集成微系统科学工程与应用重点实验室,深圳,518055;北京大学深圳研究生院集成微系统科学工程与应用重点实验室,深圳,518055;北京大学深圳研究生院集成微系统科学工程与应用重点实验室,深圳,518055 |
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| 基金项目： | 深圳科技提升计划基础研究重点项目(JCYJ20120614150120560)资助 |
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| 摘 要： | 提出一种由多种粗粒度、功能可配置的可重构算子组成的新型FPGA结构——可重构算子阵列结构,能完全替代细粒度的基于查找表的可编程逻辑单元,降低配置加载时间,同时电路速度具有可比性。可重构算子分为运算类、控制类、路径类和存储类,像电路指令集一样可支撑所有电路的实现。互连结构分为全局互连、局部互连和IO互连,分别承载远距离、邻近和系统外部的数据传输,互连开关采用通用开关阵列的形式。互连线段分为组线和单线两种,其中组线的位宽大于1比特,其行为一致,从而减小开关数目,提高传输速度。为了对该阵列结构进行性能分析和结构探索,还针对该结构进行建模,通过结构文件快速生成不同的结构,可作为深入研究的有效手段。
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| 关 键 词： | FPGA 可重构算子 结构建模 互连结构 |
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