| 基于MASH 2-1结构的小数分频锁相环的设计与实现 |
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| 引用本文： | 邓婉玲,郑学仁,刘伟俭.基于MASH 2-1结构的小数分频锁相环的设计与实现[J].华南理工大学学报(自然科学版),2007,35(6):50-53,75. |
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| 作者姓名： | 邓婉玲 郑学仁 刘伟俭 |
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| 作者单位： | 华南理工大学,微电子研究所,广东,广州,510640 |
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| 摘 要： | 设计并实现了一种3阶多级累加器级联架构MASH 2-1的数字Δ∑调制器.Matlab仿真结果显示该结构具有良好的噪声整型特性.提出了一种基于MASH 2-1Δ∑调制器的II型4阶锁相环,并给出了相应的Matlab仿真及频谱仪测试结果.结果表明锁相环的稳定输出频率符合设计要求.
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| 关 键 词： | MASH Δ∑调制器 小数分频 锁相环 |
| 文章编号： | 1000-565X（2007）06-0050-04 |
| 修稿时间： | 2006-04-04 |
Design and Implementation of Fractional-N PLL Based on MASH 2-1 Architecture |
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| Deng Wan-ling,Zheng Xue-ren,Liu Wei-jian.Design and Implementation of Fractional-N PLL Based on MASH 2-1 Architecture[J].Journal of South China University of Technology(Natural Science Edition),2007,35(6):50-53,75. |
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| Authors: | Deng Wan-ling Zheng Xue-ren Liu Wei-jian |
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| Institution: | Microelectronics Institute, South China Univ. of Tech. , Guangzhou 510640, Guangdong, China |
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| Abstract: | |
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