| CPLD应用中VHDL的优化设计 |
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| 引用本文： | 李若仲,杨晓蓉,李兆展.CPLD应用中VHDL的优化设计[J].空军工程大学学报,2003,4(2):74-77. |
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| 作者姓名： | 李若仲 杨晓蓉 李兆展 |
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| 作者单位： | 空军工程大学导弹学院，空军工程大学导弹学院，空军工程大学导弹学院 陕西三原 713800，陕西三原 713800，陕西三原 713800 |
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| 基金项目： | 军队科研基金资助项目(Y9901) |
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| 摘 要： | VHDL语言的优化设计旨在充分利用CPLD所提供的硬件资源，使项目设计能适配到一定规模的CPLD芯片中，并提高系统的工作速度、降低系统功耗。优化的主要目标是减少适配所需要的宏单元数，对比Lattice公司的芯片尤其是GLB的数目。实践证明，改变模块结构和描述方法、尽量使模块资源共享、对时序电路工作方式的变通性设计、触发器类型的选择等都是行之有效的优化方法，可在很大程度上改善项目的适配结果和系统的性能价格比，在CPM的开发应用中具有很大的应用价值。
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| 关 键 词： | CPLD 硬件资源 优化设计 描述 性能价格比 |
| 文章编号： | 1009-3516(2003)02-0074-04 |
| 修稿时间： | 2001年11月8日 |
Optimization Design of VHDL in CPLD Appliance |
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| LI Ruo-zhong,YANG Xiao-rong,LI Zhao-zhan.Optimization Design of VHDL in CPLD Appliance[J].Journal of Air Force Engineering University(Natural Science Edition),2003,4(2):74-77. |
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| Authors: | LI Ruo-zhong YANG Xiao-rong LI Zhao-zhan |
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| Institution: | The Missile Institute, Air Force Engineering University, Sanyuan 713800, Shaanxi, China |
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