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| 时钟脉冲上升沿时间对分频电路影响的实验研究与探讨 | |
| 作者姓名： | 邓己媛 黎长风 吴远泸 陈松 |
| 作者单位： | 湖南理工学院信息科学与工程学院 |
| 摘 要： | 信号上升时间或下降时间对信号完整性的影响研究往往发生在高速系统中,笔者在中低速的模数接口分频电路中发现时钟脉冲信号上升沿时间直接决定了电路能否正常分频,提出除电平匹配和负载匹配是模数接口电路中通常考虑因素外,时钟信号沿陡峭程度也是电路正常工作不容忽视的输入影响因素.并对此进行了实验研究和探讨,提出了可行的解决方案. |
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