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MPEG-2视频解码的可变字长解码器的设计
引用本文:李志俊,蔡敏,郑学仁.MPEG-2视频解码的可变字长解码器的设计[J].华南理工大学学报(自然科学版),2001,29(12):89-92.
作者姓名:李志俊  蔡敏  郑学仁
作者单位:华南理工大学,应用物理系,
摘    要:设计了一种适用于MPEG-2视频解码的可变长解码器(VLD),根据数据流的特点进行了模块划分,减少硬件开销,根据MPEG-2变字长码表的特点,采用码字分割,减少码字的存储空间,采用并地移位器,使每个周期能处理一个码字,采用VERILOG语言进行描述并通过仿真,用FPGA硬件实现后实际放映DVD影碟得以验证,通过Synopsys工具,用0.25μm工艺库综合,最坏情况下(4.75V,70℃)的工作时钟频率为150MHz,设计电路规模为五十万门左右,FPGA工作频率为50MHz.

关 键 词:专用集成电路  视频解码  变字长解码器  MPEG-2  码字分割  图像处理  设计
文章编号:1000-565X(2001)12-0089-04

The Design of VLD for MPEG-2 Video Decoder
Li Zhi_jun,Cai Min,Zheng Xue_ren.The Design of VLD for MPEG-2 Video Decoder[J].Journal of South China University of Technology(Natural Science Edition),2001,29(12):89-92.
Authors:Li Zhi_jun  Cai Min  Zheng Xue_ren
Abstract:
Keywords:ASIC  video decoder  VLD  MPEG_2
本文献已被 CNKI 维普 万方数据 等数据库收录!
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