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嵌入式设备中高速处理器对低速串行总线接口设备通常是使用软件延时来满足低速串行总线接口的时序要求,大大降低了CPU资源的有效利用率。本设计使用CPLD器件作为CPU的协处理器,负责完成单总线设备的数据读取,并转换为并行数据供CPU读取。从而减少CPU读取低速串行总线设备的等待时间。实验中该接口工作稳定可靠,满足设计要求,实验表明该设计方法是行之有效的。 相似文献
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在教学型本科院校《数字电子技术》教学中,依托国家特色专业建设的实施,本着"加强基础,注重实践,以项目驱动强化工程意识和实践能力培养"的原则,从课程目标、理论教学、实验教学的设计方面对电子信息工程、通信工程等专业的该课程教学改革进行了探索与实践。实践证明该建设是行之有效的,文中重点讲述了该课程教学设计思想与实践过程,同时介绍了课程设计案例及教学实践过程。 相似文献
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为对电子测量仪器进行大规模综合集成,在μCLinux下,以主从分布式FPGA／SOPC构建仪器数字平台,设计32位Nios-Ⅱ软核处理器的嵌入如CLinux系统,设计模拟电路,在μCLinux的控制下,有效地实现双通道100MHz示波器、32通道100MHz逻辑分析仪、30MHz任意信号发生器、2．7GHz频率计、常用数字IC故障测试仪、全自动LCR测量仪等仪器集成．详细介绍仪器集成的结构、各子仪器的FPGA／SOPC及μCLinux系统操作平台设计,实验效果好,实践表明该设计是行之有效的。 相似文献
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介绍了NiosII处理器的外设IP的设计方法,并详细介绍了用于多片FPGA间的命令、数据传输的自定义高速串行接口IP设计、验证和测试方法。该设计使用VerilogHDL语言完成硬件逻辑部分设计,对主从串行模块进行了详尽的协议设计,并编写了相关的驱动程序。实验表明该IP可被无缝整合到各种形式的SOPC嵌入式系统中。 相似文献
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基于Linux＆Qt的嵌入式数字多用表图形用户界面设计 总被引：1，自引：0，他引：1
为设计嵌入式计算机仪器用户图形化（GUI）界面,在ARM处理器硬件平台上,采用Linux与Qt／Embedded技术开发出新型、智能、移植性强的嵌入式数字多用表的GUI软件,实验表明该软件界面友好、易于移植、调节灵活、使用方便,实践证明该设计是切实可行的,文中详细介绍仪器系统结构、系统软件的实现原理和设计方法,同时结合本软件的设计实例,分析Qt编程中串行接口的设置与数字多用表界面的实现。 相似文献
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