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整经机上丝线的毛刺、打结等,采用了光电式检测技术,但由于丝线运行速度快、有抖动,运行环境的光、电干扰较强,毛刺在输出端产生的信号变化甚小.为提高弱信号检测的灵敏度,采用了动态检测、降低电路噪声和双重判断等措施,有效地降低了系统的误检率,提高了系统的可靠性. 相似文献
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VHDL语言的优化设计旨在充分利用CPLD所提供的硬件资源,使项目设计能适配到一定规模的CPLD芯片中,并提高系统的工作速度、降低系统功耗。优化的主要目标是减少适配所需要的宏单元数,对比Lattice公司的芯片尤其是GLB的数目。实践证明,改变模块结构和描述方法、尽量使模块资源共享、对时序电路工作方式的变通性设计、触发器类型的选择等都是行之有效的优化方法,可在很大程度上改善项目的适配结果和系统的性能价格比,在CPM的开发应用中具有很大的应用价值。 相似文献
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整经机上丝线的毛刺、打结等,采用了光电式检测技术,但由于丝线运行速度快、有抖动,运行环境的光、电干扰较强,毛刺在输出端产生的信号变化甚小。为提高弱信号检测的灵敏度,采用了动态检测、降低电路噪声和双重判断等措施,有效地降低了系统的误检率,提高了系统的可靠性。 相似文献
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