排序方式： 共有1条查询结果，搜索用时 93 毫秒
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提出了一种适用于TLB的低功耗内容寻址存储器电路,该电路用两级比较的方法实现TLB的查找功能．由功耗模型的分析得到低功耗CAM的最优设计参数,通过减小电压摆幅的办法进一步降低功耗．电路在0．18／μm 1P6M标准CMOS工艺上实现,仿真结果表明64路TLB的最大比较延迟为0．983ns,功耗为4．59μW／bit． 相似文献
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