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提出了一种扩大时间放大器线性范围的技术.采用这种方法的时间放大器可同时应用于较大尺寸和较小尺寸的工艺下时间数字转换器以及全数字锁相环的设计.时间放大器采用2个传统的基于SR-latch的时间放大器,通过调整逻辑和参数组合而成,以达到在时间放大器比较小的输入输出延迟的条件下实现线性范围最大化的目的.该方法通过采用0.18μm工艺和采用90 nm工艺的时间放大器的设计进行验证,采用0.18μm工艺的时间放大器放大倍数48,线性度1 bit,裕度30 ps,线性范围达到了61 ps,仿真得到电路最终参数与计算值吻合;采用90 nm工艺的时间放大器放大倍数48,线性度1 bit,裕度10 ps,线性范围达到了23 ps也满足要求. 相似文献
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