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91.
基于VHDL的多功能数字闹钟设计 总被引:2,自引:0,他引:2
针对多功能数字闹钟的设计提出了三种可行性设计方案,并对这些方案的优缺点进行了比较论证,在充分考虑各种方案优缺点的前提下,选择利用FPGA芯片来设计多功能数字闹钟.本设计选用可编程器件FPGA采用硬件描述语言VHDL按照自顶向下的设计方法设计了数字闹钟的各个模块,并对各个功能模块进行了软件仿真. 相似文献
92.
介绍了基于I2C总线的可预置、可存储多功能电子时钟系统的设计,给出了系统的硬件结构及软件体系结构。使用有限状态机思想设计了人机界面,对I2C总线模拟软件包VIIC进行了分析,并介绍了它在四位单片机上的移植方法。 相似文献
93.
基于Morse码的基本原理,提出了一种基于有限状态机的Morse码自动识别算法.将电键拍发过程划分为6种状态,利用VHDL硬件描述语言的强大逻辑描述能力,给出了在MAX PlusⅡ开发软件环境下,设计识别Morse码的具体方法和仿真分析结果.算法能根据报务员发报时的码速确定Morse码的判别门限,大大提高了码字识别的准确率. 相似文献
94.
在SoC设计流程中,传统的仿真验证方法存在可观察及可控制性较差、自动化水平低等缺陷.为此,提出了一种基于扩展有限状态机(EFSM)和断言的SoC接口协议测试平台,该平台是一种自反馈测试平台,它不仅可以自动产生大量符合协议规范的测试激励矢量,而且可以通过对断言统计信息的反馈提供多种偏置选择,从而进一步提高验证的自动化水平.将该平台用于对视频后处理芯片中Wishbone总线接口协议的功能验证当中,验证结果表明,该平台可以缩短仿真验证时间大约55%~65%左右,有效地提高了验证的效率和质量. 相似文献
95.
Propose the sequential circuits with the ternary D-ffs in series~1. Discuss the equivalence between the sequential circuits with the p-valued flip—flops in series and in parallel as a part of studying the multiple valued logic circuits. 相似文献
96.
基于FPGA的通用异步收发机的设计 总被引:1,自引:0,他引:1
阐述了通用异步收发机(UART)异步串行通信原理,介绍了实现UART异步串行通信的硬件接口电路及各部分硬件模块,同时还介绍了用硬件描述语言Verilog来开发UART通信接口电路模块的方法.研究基于Verilog语言,结合有限状态机的设计方法来实现UART,将其核心功能集成到现场可编程门阵列(FPGA)上,使其整体设计紧凑、小巧,实现的UART功能稳定、可靠;同时,与其他设计方法相比较,利用有限状态机的方法具有结构模式直观简单,设计流程短,程序层次分明,易综合,可靠性高等优点,这种方法必将在电子设计自动化(EDA)技术中发挥重要作用. 相似文献
97.
很多设计中都是为FPGA设置一个基于12C总线的主控制器接口,而将FPGA作为12C总线上的从器件则很少,但事实上,低速主控单片机和受控高速FPGA从处理器组成的系统应用场景很广.因此本文分析了12C总线的操作过程,得到了状态机,在此基础上用VHDL语言实现了遵从12C总线协议的从器件接口.实践表明,所设计的从器件接口工作良好,具有一定的实用价值. 相似文献
98.
99.
基于有限状态机理论,分析了电控摩托车发动机的工况划分依据及成立的条件,建立了工况判别和转换策略模型.利用MATLAB软件中的Simulink和Stateflow工具箱,根据发动机实际运行条件对工况判别和转换进行了仿真研究.仿真结果表明工况判断和转换策略模型正确. 相似文献
100.
为了在高速网络中实时、准确地识别多种协议产生的分组流,首先分析现有的识别方法,然后从应用协议有限状态机角度出发,提出使用完美有限状态机统一描述不同识别方法的思想。在此基础上,提出了基于流序列的分组流识别方法,利用协议有限状态机中状态变化特征识别特定协议产生的分组流,并提出了一个状态特征聚合算法,以构造协议状态特征集合。通过识别基于UDP的Skype语音流,说明此方法的可行性和有效性。 相似文献