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81.
介绍了一种40±16×16位高速乘累加/减器的设计。该乘累加/减单元支持有符号数、无符号数及混合符号数的乘法、乘累加/减运算,并支持多种舍入的乘法、乘累加/减运算。该单元采用了改进的Booth算法和Wallace树结构,简化了部分积的产生,及部分积符号的扩展;优化了Wallace树的连接结构,及后续多个操作数的处理次序,从而显著地提高了乘累加/减器的速度。该设计综合考虑了高性能通用DSP对乘累加/减器的要求,作为某高速高性能定点DSP的一部分,已经实现了RTL电路设计、功能仿真、和PC综合,并准备流片且进行FPGA系统开发板的芯片验证。 相似文献
82.
83.
32位快速乘法器的设计 总被引:1,自引:0,他引:1
高性能乘法器是现代微处理器中的重要部件,乘法器完成一次乘法操作的周期基本上决定了微处理器的主频。传统的乘法器的设计,在最终的乘积项求和时,常采用阵列相加或叠代相加的方法,不适用中小规模的微处理器的设计。该文提出的32位乘法器,采用了Booth编码、4-2压缩器、Wallace树算法以及超前进位加法器等多种算法和技术,在节约面积的同时,获得了高速度的性能。 相似文献
84.
描述了一种针对高精度要求的二阶ΣΔ A/D转化器抽取滤波器设计和硬件实现的解决方案;提出了一种能够实现2倍抽取的通用无乘法器硬件实现结构,该结构能有效实施半带滤波器和其他高阶FIR的2倍抽取功能。整个滤波器采用无RAM/ROM技术,实现了低通带文波、窄过渡带、高阻带衰减和高抽取率的系统要求,以很低的硬件代价实现了一个16位精度的ΣΔ A/D转换器。 相似文献
85.
10级流水线双精度浮点乘法器的设计 总被引:1,自引:0,他引:1
提出了一种基于IEEE754标准的双精度浮点乘法器的流水线设计方法. 该方法面向32bit数据通路的数字信号处理器,每个64bit双精度浮点操作数划分为2个32bit数据, 采用32bit×32bit无符号阵列乘法器实现有效数的相乘,并通过控制部分积与其选择信号在流水线中的同步传递,用1个66bit加法器实现了4个部分积的相加. 采用提出的舍入方法完成了有效数的舍入. 整个双精度浮点乘法器的设计分为10级流水线. 硬件仿真验证了该方法的正确性和有效性. 相似文献
86.
文章给出了两种单相电力线路参数的测量方法 ,详细论证了 V/F转换器件的积分功能 ,并论证了其在 URMS,IRMS和 P值测量中的应用。由于考虑了在测量中电网电压频率的偏移和波形的失真 ,并依据 URMS,IRMS和 P的原始定义进行设计 ,因而可实现高精度的测量 相似文献
87.
研究有限域(定义在GF(2)上的m维向量空间)的正规基乘法器。基于域元素的正规基表示和多项式基表示可以相互转换,通过分析多项式基下的乘法运算公式,得到利于串行乘法器设计的有效性质。利用该性质,提出了一个新的串行正规基乘法器,该乘法器要求(2m-2)个二值输入的异或门,m个二值输入的与门。在进行具体的硬件实现时,所需要的存储空间为3m+1。 相似文献
88.
YANQingxu HOUShuiHung HUANGGuangdong WANLi 《系统科学与复杂性》2005,18(3):419-428
The stabilization problem of a nonuniform Timoshenko beam system With coupled locally distributed feedback controls is studied. First, by proving the uniqueness of the solution to the related ordinary differential equations, we establish the asymptotic decay of the energy corresponding to the closed loop system. Then, by virtue of piecewise multiplier method, we prove the exponential decay of the closed loop system. 相似文献
89.
模拟乘法器在测量机械功率、电功率、电能导领域中得到广泛应用,它的性能对整个装置将起决定性作用。本文介绍一种实用的模拟乘法器电路,分析温度对乘法器宽电路的影响,论述采样保持电践与调宽电路构成一种新颖乘法器的原理。 相似文献
90.
模拟乘法器在测量机械功率、电功率、电能导领域中得到广泛应用,它的性能对整个装置将起决定性作用.本文介绍一种实用的模拟乘法器电路,分析温度对乘法器宽电路的影响,论述采样保持电践与调宽电路构成一种新颖乘法器的原理 相似文献