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1.
从消除时钟冗余,提高时钟利用率以达到降低功耗的思想出发,提出基于双边沿触发的触发器的逻辑设计。新构建的双边沿触发器逻辑功能正确,时钟利用率高,功耗降低显著. 相似文献
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短的CP边沿时间,是触发器正常工作的重要条件之一.用实验展现了CP边沿时间过长时集成TTL JK边沿触发器出现的异变现象,探明了产生异变现象的原因,推导了CP边沿时间最大值的计算公式,与实际测量取得了一致的结果. 相似文献
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从消除时钟冗余,提高时钟利用率以达到降低功耗的思想出发,提出基于双边沿触发的触发器的逻辑设计。新构建的双边沿触发器逻辑功能正确,时钟利用率高,功耗降低显著. 相似文献
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任骏原 《吉林大学学报(信息科学版)》2013,31(2):170-172
为了研究单稳态触发器的触发特性, 分析了555单稳态触发器的触发特性, 研究了电路输出状态与外加触发信号的关系。发现输入触发信号为周期性脉冲信号时输出信号对输入信号的分频作用, 从而扩展了单稳态触发器的应用方向。Multisim仿真实验证明了所述观点正确性。 相似文献
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梁湖辉 《科技情报开发与经济》2007,17(1):278-279
从概念到时序图等几个方面介绍了主从式J-K触发器与边沿式J-K触发器的主要区别,并分析了两者在何种特定的工作条件下,功能才会相同。 相似文献
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晶闸管数字触发器快速性问题的研究 总被引:1,自引:1,他引:0
分析了一般数字式晶闸管触发控制器在脉冲形成过程中所产生的延迟作用及影响其快速性的原因,提出了一种可以有效消除这种延迟作用的数字式触发脉冲形成方案,使数字触发控制器的响应速度显著提高,从而使其具有较宽的适用范围。 相似文献
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着重对主从型JK触发器CP=1期间,输入信号有变化的情况进行了分析,得出一次变化问题产生的原因及后果.强调CP=1期间,输入端信号必须保持不变. 相似文献
11.
随着EDA技术的广泛应用,大大缩短了电子产品的开发周期.在分析数字逻辑分析仪触发电路工作原理的基础上,讨论了其触发电路模块的FPGA实现方法,给出了部分电路的程序设计. 相似文献
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许碧惠 《甘肃联合大学学报(自然科学版)》2009,(Z1):113-115
触发器是最基本的时序逻辑电路,在时序逻辑领域内占有相当重要的地位.总结触发器教学经验,寻求适合触发器教学的方法,使学生能较好地掌握触发器的电路结构、工作原理和逻辑功能,为后续时序逻辑电路的学习打下扎实基础是很有必要的. 相似文献
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基于SET-MOS混合结构的或非门构建了基本RS触发器和主从式D触发器,对所设计的新型触发器电路进行了分析研究,并将其应用到寄存器和移位寄存器电路.利用SPICE对所设计的触发器电路进行仿真验证,仿真结果表明电路运行良好.该新型触发器电路与SET实现的电路相比,具有更高的驱动能力;与传统CMOS电路相比,电路的功耗仅为10-10 W的数量级. 相似文献
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用Multisim软件分析触发器的状态变化过程 总被引:9,自引:0,他引:9
介绍了用Multisim仿真软件分析触发器状态变化过程的方法,即用Multisim仿真软件中的字组产生器产生触发器的时钟脉冲、数据输入、异步控制等多路信号,字组产生器的字组内容反映触发器状态变化特点及逻辑功能;用Multisim中逻辑分析仪多踪同步显示触发器的各种输入及状态输出波形,可直观描述触发器的状态变化过程。所述方法的创新点是解决了触发器的工作波形无法用电子实验仪器进行分析验证的问题。 相似文献
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本文介绍了内反馈串级调速系统在风机、水泵上的节能应用,分析了系统的组成和工作原理,与传统的串级调速系统相比,可靠性高、价格低,改善了功率因数,针对触发电路抗干扰问题,提出了切实可行的措施。 相似文献
16.
EDA技术的广泛应用大大缩短了电子产品的开发周期。在分析逻辑分析仪工作原理的基础上,讨论了其触发电路模块的工作原理及其FPGA的实现方法,并给出了部分电路的程序设计及仿真结果。 相似文献
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张继军 《山东科技大学学报(自然科学版)》2005,24(1):66-69
利用引入含时钟信号的触发器激励方程,提出了一种新的时序电路的分析方法,实现了同步、异步时序电路分析过程的统一;对于异步时序电路,所求得的触发器激励方程与同步时序电路的触发器激励方程是一样的,且该方法与传统的同步时序电路的分析方法是一致的。 相似文献
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特性方程和电压波形图都是触发器重要的逻辑功能表示方法.文中结合具体实例,说明直接根据特性方程画主从触发器电压波形图时会遇到的问题,并结合其电路结构及动作特点给出了解释,指出了特性方程适用的条件,同时也总结出了主从触发器电压波形图的画法.这种提出问题、分析问题并解决问题的教学方法可以提高学生的学习兴趣并加深对内容的理解,提高教学质量. 相似文献