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高性能密码服务器的并行数据处理 总被引:2,自引:0,他引:2
随着大型电子商务和电子政务系统中客户数量的增多,主机端密码系统的性能成为提供安全服务的限制因素。提出了一种基于可编程密码模块的密码服务器体系结构。通过在模块中使用密码算法代理抽象密码芯片运算资源,管理机可以调度系统计算资源支持多模块内多密码芯片间的并行密码运算。在IBMService345和SJW系列PCI密码卡上,设计实现了基于算法代理间并行运算的高性能密码服务器。测试结果显示:用20个SSX04模幂运算芯片间并行签名(1024 bitRSA)速率达到1100次/s;用10个对称密码算法芯片并行加密(ECB模式),系统吞吐率达到312.6Mbps。 相似文献
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本文概述了反坦克导弹实时仿真系统组成及采用Trasnsputer IMS T800芯片构成并行处理机,在实时仿真图像生成中的应用。对图像系统的体系结构,软件特点和并行处理技术在图像生成中的具体实现作了简要介绍。 相似文献
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针对机载雷达的高速大容量实时信号处理任务,为了提高系统的通用性,提出一种基于DSP芯片的机载雷达通用并行信号处理系统(AUPSPS)设计方案。该系统以DSP芯片为核心处理节点,采用各节点独立存储及数据流水方式实现多DSP的完全并行处理。系统具有通用性和可扩展性好,数据吞吐量大,并行处理效率高,系统结构简单清晰,硬件资源节省,设计开发简便等优点,不但可以灵活适应于机载雷达的各种数据处理算法,而且可应用于其它平台的雷达信号处理机中,实现雷达信号的高速实时并行处理。 相似文献
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高速并行FIR滤波器的FPGA实现 总被引:2,自引:0,他引:2
提出了一种基于多相滤波器的并行有限脉冲响应(finite impulse response,FIR)滤波器结构,可以有效提高滤波器运算的吞吐率,与传统的串行滤波器结构比,并行滤波器运算速度可以提高L倍,其中L为并行的路数,并且运算延迟小.首先从理论上分析了基于多相滤波器的并行滤波原理,并以八路并行为例,对FIR滤波运算做了浮点仿真验证.然后用经典符号数表示以及优化定点滤波器系数,并针对滤波器系数设计了流水线结构.最后在Altera的Stratix II系列芯片上实现了定点并行滤波器.可编程逻辑阵列(field programmable gatearray,FPGA)编译以及下载测试结果表明,该滤波器仅占用少量的资源,其等效吞吐率可以达到2 GHz. 相似文献
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国产高性能计算(high performance computing,HPC)系统研制世界领先、芯片架构百花齐放,系统运营依托国家超算中心形成良好发展态势。国产高性能并行应用在若干关键技术点方面世界领先,应用支撑环境发展迅速,但工业软件和队伍建设挑战巨大。在后摩尔时代,需要立足人类文明进步来推动并行应用软件生态建设,工业软件要从产品角度全方面与国外商业软件进行对标;重点关注应用软件云、软硬件协同优化、面向领域的定制芯片架构和定制编译技术;在开源模式、知识产权保护和人才评价方面要与时俱进,从制度上促进应用软件生态的繁荣。 相似文献
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双C50多模同步采集高速目标识别系统 总被引:3,自引:2,他引:1
研究了红外多模采集转换的系统模型 ,分析了功能状态。研究了基于并行DSP、数据并行通信芯片和可编程逻辑器件构架的可行性系统实现 ,论证了系统的实时并行处理能力。研究了数字锁相实施玫瑰线扫描同步采集方位转换和红外多帧配准图像模糊分割识别系统实现。实验表明 ,该系统具有 2 5 6× 2 5 6像素场景 ,2 5 6级灰度级实时监测和复杂背景下实时识别目标的能力。 相似文献
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多GPU无合成绘制算法采用混合sort-first与sort-last的并行绘制模式,将绘制任务划分为多个子任务集合进行并行绘制并异步合成显示。原方法中对屏幕的分割方式过于平凡,未明确提出一种高效的屏幕分割策略,从无合成算法本身特性出发,提出一种自适应屏幕划分策略,该算法根据GPU数目及绘制分辨率参数,启发式计算屏幕初始划分方式,再采用统计性能反馈的方式动态选择最佳屏幕划分方式,较原有方法更易于实现子屏幕任务的负载平衡,实验表明,算法在带来很少额外计算开销的同时,能够有效平衡并行绘制任务负载,进一步发挥多GPU无合成并行绘制系统的绘制效率。 相似文献
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时域有限差分并行算法中的吸收边界研究 总被引:2,自引:0,他引:2
针对并行FDTD中以二阶Mur、单轴各向异性介质完全匹配层(UPML)和卷积形式完全匹配层(CPML)为吸收边界的并行化处理方法进行论述.用金属球的远区散射计算,并与Mie级数解对比,验证了并行计算中三种吸收边界的吸收效果.最后给出UPML吸收边界FDTD计算内存估计公式,并以电大尺寸目标卫星模型为例对并行性能进行了测试.由于并行中通信时间影响并行加速比和效率,UPML和CPML吸收边界的相邻子域数据通信方式与FDTD选代式相同,而Mur吸收边界的相邻子域间数据通信方式与FDTD完全不同,它的并行性能要低于前两者.电大尺寸卫星目标模型的多机并行计算测试结果表明,UPML和CPML并行FDTD计算的并行加速比及其效率整体上高于Mur,其中CPML吸收条件下的效率达到90%以上. 相似文献
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资源受限单机动态调度的并行GA算法研究 总被引:2,自引:1,他引:1
研究资源受限系统动态调度问题,针对时序约束问题提出一种并行遗传算法(PGA)。给出满足排序优先次序约束的一种基因编码方法;采用不破坏优先级可行性的交叉操作,并予以证明:建立一种并行处理机制,使搜索避免出现局优现象。在技术允许情况下,单机动态调度引入抢占式加工方式,会一定程度上提高系统的性能。通过仿真试验验证,并行OA算法可兼顾优化效果和计算效率,解决单机动态调度问题。 相似文献
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本文第一部分介绍在现有技术条件下使计算机性能实现飞跃的一种新型体系结构——连接计算机(CM)的系统结构。详细论述了这种称之为大规模并行的机器的发展过程、工作原理及其软件环境。第二部分介绍CM的改进型CM-2在结构及性能上的许多重要改进,包括增加浮点加速器和高速I/O系统、重新设计处理器芯片、改进通信网格等。第三部分论述这种并行计算机的广阔应用前景,具体讨论了在材料学、VLSI设计及计算机视觉等三个领域中的应用情况。 相似文献
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基于DSP-FPGA的二次雷达信号处理机的实现 总被引:4,自引:0,他引:4
针对二次雷达信号处理 ,探讨了采用数字信号处理芯片 (DSP)和可编程逻辑电路 (FPGA)的全数字化处理方案。重点研究了共享存储器、消息传递机制、大量数据交换等多DSP并行处理的方法及过程。通过具体的测试表明 ,采用并行化的DSP处理方法 ,增强了系统的灵活性和可靠性 ,大大提高了系统的检测性能 相似文献
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内建自测试(BIST)是解决系统芯片(SoC)测试问题的首选可测性设计方法。为了缩短SoC中的BIST测试时间,应该使尽可能多的BIST模块并行测试。然而过度的并行会引起测试功耗过高,对SoC产生不利的影响。为了改善这个问题,提出了基于多相测试时钟以及在峰值功耗的限制下,通过遗传算法对各BIST模块进行时钟相位分配与时序安排的优化调度算法,使SoC在测试时间得到优化。通过对ISCAS标准电路组成的SoC进行算法仿真,实验结果表明这种方法可以有效地组织测试,提高测试效率。 相似文献
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陈志才 《系统工程与电子技术》1993,(10)
本文介绍利用单计算机与C语言开发的在Unix操作系统控制下运行的IP—1并行计算机仿真程序PCS。该程序提供一个多处理机并行程序的仿真执行环境,并在执行过程中能观察某些变量的中间结果。其目的在于辅助并行程序的调试和并行算法的研究。 本文提出了IP—1并行计算机的仿真模型:将多处理机映射到多进程,多路存取存贮器映射到MAM数据数组,纵横开关映射到交换控制函数,并行性映射到并发性及并行运行方式映射到串行运行方式。 相似文献
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