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LT码是一类典型的喷泉码,具有较强的纠错纠删能力,在网络通信和深空通信中有较大的应用潜力。在介绍LT码基本思想和编译码原理基础上,设计了定长LT码编码器和译码器的FPGA实现结构,对其所需实现资源进行了深入分析,验证了LT码硬件实现的可行性,同时对所设计的LT编码及译码过程进行了Matlab仿真实验,实验证明丢包率不同对LT码的性能影响不大,而度分布则产生了很大的性能差别。 相似文献
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隐蔽通信中的Turbo码并行译码 总被引:1,自引:0,他引:1
针对隐蔽通信的低信噪比应用背景,引入高效信道编码Turbo码提高系统可靠性,并提出一种基于尾比特插入的并行译码算法以减小译码时延并提高码字的保密性.该算法在编码过程中周期插入归零比特使编码器回归到确知状态,译码器根据尾比特的位置划分子块并确定各并行子译码块的初始化值.所插入尾比特可看作“伪信息”,具有随机性,增强了通信的保密性.仿真结果表明,相对于传统并行译码,所提译码方案在提高Turbo码译码速率减小译码延时的同时,不会因为边界条件模糊而产生性能损失,适用于极低信噪比的隐蔽通信环境. 相似文献
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目前,Turbo卷积码、分组Turbo码以及低密度校验码由于它们接近Shannon极限的性能而成为最先进最受欢迎的纠错码.尽管,这三种纠错码得到了广泛的研究,但公开的仿真代码目前只有Turbo卷积码和LDPC码.本文简述了分组Turbo码的编码与译码过程,并提供了仿真中关键部分的标准C++代码,最后给出了仿真结果. 相似文献
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针对协作中继网络中目的端接收来自不同源节点发送的多个信息副本的合并方式,提出了联合非规则重复累积码与网络编码的改进译码算法. 首先对各链路的调制信息进行软解调处理,并根据中继处网络编码的异或信息和直达链路中原信息的函数对应关系,提取出协作节点发送到目的端的信息副本;然后更新非规则重复累积码在译码过程中直达链路与协作链路下的两个信息副本的软解调信息,构造出新的译码判决方法,进而推导了16QAM 软解调对数似然比值的简化方法;最后分析了系统的中断概率及频谱效率. 仿真结果表明,该译码算法在QPSK、16QAM两种调制方式下均能获得较低的误比特率,且采用对数似然比值的简化方法,能在0.3 dB 性能损失代价下降低系统的译码难度. 相似文献
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平面机构运动链的分类与同构识别是机构结构分析与类型综合中的重要问题.对平面机构运动链结构组成进行探讨后,研究了运动链中的结构不变量.并基于缩杆关联矩阵提出了分类码与同构码,以此为基础,进一步提出了对运动链进行分类的基本码法以及同构识别的码谱法.基本码法分类的运动链类型机构组成学意义明确,利于机构特性分析.同构识别码谱法是对运动链进行分类细化后的同构识别,因此具有可靠性好、识别效率高等特点,已成功应用于12杆以下机构运动链型综合时的同构识别. 相似文献
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基于VC的BCH码迭代译码算法实现 总被引:1,自引:0,他引:1
在现代通信系统中,纠错码技术是实现可靠通信的基本方法.本文首先对纠错码技术做一下简介,然后以(63,39)码为例,着重讨论用VC 6.0对BCH码迭代译码的进行实现. 相似文献
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讨论了一个不同于BB84协议的量子密匙传输协议的安全性。尽管从理论上看这个协议给密匙传送带来了1/4的冗余编码,从而导致传输效率变低,但它依然简单,而且在对抗PNS(Photon Number Splitting)攻击的过程中,比BB84更安全。然而,研究发现这一新的量子密码协议仍然有漏洞可以利用,使窃听者获得有用的信息。作为应用结果,还讨论了使用这个协议传递密匙的一次性便笺(vernam cipher)的安全性问题。 相似文献
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研究了有限域上线性码深度分布的反问题,即对于给定的一组自然数,如何构造一个线性码使其深度谱恰好为给定的自然数组。讨论了线性码的深度分布与周期分布的关系,得出了一种由深度分布求出周期分布的方法。 相似文献
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提出一种新的结合多级编码和差分空时调制的联合编码调制方案.该方案通过特定的构造法则,用一个多级低密度校验码取代多级编码中多个分量码,因而具有更低的编译码复杂度.为防止过多错误反馈造成译码失效,提出采用内、外双重迭代方式来提高系统的鲁棒性.同时把LDPC码校验矩阵作为迭代终止判决准则,进一步降低了迭代算法的平均复杂度.在准静态多输入多输出衰落信道下的仿真结果表明,系统性能得到有效提高. 相似文献
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纠错码的深度分布在其周期分布研究中的应用 总被引:12,自引:1,他引:11
将纠错码的深度分布与周期分布建立了联系.对于码长为2幂次的线性码,给出了用深度分布求解周期分布的方法,并确定了码长为2幂次的扩展汉明码和扩展循环码的周期分布. 相似文献
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作为LDPC码的一个重要分支,QC_LDPC码在LDPC码的研究领域内吸引了越来越多的注意力。很多实际通信系统中都使用多码率QC_LDPC码作为信道编码方案,以实现多码率可靠通信。为了实现同时支持几种不同码率和码长的QC_LDPC码译码器,提出了一种基于基矩阵的译码器结构,并且采用归一化最小和算法作为译码算法,它能够在保证译码性能的同时降低译码器硬件实现复杂度。最终通过Verilog HDL语言,利用现场可编程门阵列FPGA实现了能够非常灵活的配置不同码率和码长的QC_LDPC码译码器。 相似文献