锁相环高性能电荷泵电路的设计

设计了一种新型电荷泵电路,该电路采用了差分反相器,可工作在2 V的低电压下,具有速度快、波形平滑、结构简单、功耗低等特点.HSpice仿真结果显示,电荷泵的工作频率为10 MHz时,功耗仅为0.1 mW,输出信号的电压范围宽(0~2 V).该电路可广泛应用于差分低功耗锁相环电路中.     

高性能电荷泵的锁相环电路

为满足锁相环电路高稳定性、低功耗的要求,提高其整体性能,通过对普通型电荷泵锁相环电路模块的改进,设计了一种高性能差分型电荷泵锁相环。该电路包括鉴频鉴相器、分频器、差分电荷泵和压控振荡器的电路结构。仿真结果表明：该差分型电荷泵锁相环的锁定时间为10μs、频率抖动为0.0002MHz、周期抖动为2 ps,与普通型电荷泵锁相环相比,可达到快锁低抖的目的。     

一种高性能4阶电荷泵锁相环的设计

文章设计了一款完全集成的高性能4阶电荷泵锁相环.根据系统性能要求,该锁相环的环路滤波器选用3阶无源低通滤波,其他模块在典型结构的基础上采取了改进措施以获得高性能.首先,利用MATLAB进行系统建模,获得锁定时间和环路参数;然后给出了关键电路的结构以及前、后仿真的结果.在SMIC0.35μm 2P3M CMOS工艺条件下,该锁相环的正常工作范围为60～640 MHz,400 MHz时周期到周期抖动为96 ps,面积为0.38 mm2.内嵌本电路的一种DAC芯片已交付数据,成功参加MPW项目流片.     

一种改进型高性能CMOS锁相环电荷泵的设计

设计了一种高性能锁相环电荷泵电路.该电路采用UMC 0.18μm Mix-Mode CMOS工艺实现.仿真结果表明,通过利用电荷共享加速电流镜的开启,该电荷泵开启时间仅为0.3 ns,不会产生鉴相死区,能较好地抑制时钟馈通、电荷注入等非理想特性的影响,并且适合于低电压工作.通过与传统型及参考型两种电荷泵电路的仿真对比,验证了所设计电荷泵的优越性.     

一种可用于高性能锁相环的CMOS电荷泵

文章提出了一种可用于高性能锁相环的CMOS电荷泵,电路采用电流舵技术来缩短切换时间,通过降低差分对管栅电压的变化速率,显著地减小了毛刺,使输出电流波形更平滑、输出电压谐波分量更低,该电路同时还消除了死区现象;最后用CMOS电荷泵与一种典型电荷泵作仿真结果对比,突出了CMOS电路的优点。     

一种用于锁相环的正反馈互补型电荷泵电路

给出了一种新型的互补型电荷泵电路．采用正反馈技术,电路由CSMC1．2μm CMOS工艺实现,可工作在2V的低电压下．Spectre仿真结果显示,电荷泵的工作频率为100MHz时,功耗为0．08mW,输出信号的电压范围宽(0～2V),电路速度快,波形平滑,抖动小,在不增加电路功耗的前提下消除了传统电荷泵电路的电压跳变现象．该电荷泵电路可以很好地应用于低电源电压、高频锁相环电路．     

锁相环中的新型电荷泵电路

分析了锁相环中电荷泵产生的误差,提出了一种新型的电路,这种新型电荷泵能消除过冲注入电流,其误差特性远优于传统的电荷泵.通过SPICE仿真对两种电荷泵进行了比较.     

高速SerDes电路中电荷泵锁相环的设计

面向高速串行接口应用,设计一款低噪声、快速锁定的高性能锁相环电路,作为5 Gbit· s-1数据率的SerDes发射芯片的时钟源。该设计通过锁存RESET方式增加延迟时间,以减小鉴频鉴相器的死区效应,降低锁相环整体电路的杂散;其压控振荡器采用4 bit二进制开关电容的方法,将输出频率划分为16个子频带,以获得较大的输出频率范围,同时又不增加压控振荡器的增益;在SMIC 55 nm工艺下完成锁相环电路版图设计,核心芯片面积为054 mm2。后仿真结果表明:输出频率覆盖46~56 GHz,1 MHz频偏处的相位噪声在-110 dBc·Hz-1 附近。测试结果显示,RMS 抖动和峰峰值抖动分别为287 ps和134 ps,整体电路功耗为37 mW。     

一种高性能双锁相环的设计

锁相频率合成是间接频率合成的一种,它是一个基于相位比较的负反馈控制系统。但是,由于传统锁相环中只有1个VCO,而普通的VCO不具有跨倍频程的变频范围,这使得只有一个VCO的PLL输出频率范围受到限制。本文给出了一种高性能双锁相环系统的设计。可输出宽频段、低相噪的本振信号。结果表明,这个电路不仅满足了指标要求,还符合批量生产的要求。为其他人进一步研究类似锁相环提供了不错的经验和参考。     

电荷泵锁相环设计方法研究

在归纳单端输出电流型电荷泵锁相环设计方法的基础上 ,给出单端输出电压型电荷泵锁相环的两种设计方法 :直接近似为电流型输出 ;串接电阻转换为电流型输出 .实验验证了其正确性 ,从而纠正了 Motorola公司设计方法的错误     

一种新型锁相环电路

本文根据两同频同幅方波电压信号之间相位误差脉冲电压的平均值与二者相位误差成线性关系的原理,设计成以或非门实现压控振荡,以R—S触发器,RC微分电路实现相位比较,以两支三级管实现脉宽鉴别,构成开关量形式的锁相环,并以波形分析说明该电路的工作原理和同步跟踪范围的确定,尽而克服了模拟电路锁相环相位误差电压同相位误差之间成非线性关系的缺点。     

电荷泵锁相环设计方法研究

在归纳单端输出电流型电荷泵锁相环设计方法的基础上,给出单端输出电压型电荷泵锁相环的两种设计方法,直接近似为电流型输出;串接电阻为电流型输出,实验验证了其正确性从而Ｍｏｔｏｒｏｌａ公司设计方法的错误。     

一种电荷泵锁相环的多层行为级模型

提出了一种全新的电荷泵锁相环的行为级建模方法.采用多层模型,能根据需要在仿真的精度和速度间进行权衡,在可独立配置的不同层次中描述锁相环系统的理想行为和非理想行为.与传统的电荷泵锁相环模型相比,灵活性大大提高.该建模方法还提供了一个专用层进行时域噪声仿真,使得系统的噪声特性得以更准确的验证.该多层模型用 Verilog-A建立,用SpectreTM进行仿真.在精度损失很小的情况下仿真速度有20到99倍的提高.     

锁相环中低电流失配电荷泵的设计

提出了一种应用于低供电电压低相位噪声锁相环系统的低电流失配的电荷泵电路。仿真结果表明,输出电压0．4V～1．3V范围内。电荷泵上下电流失配小于1％,满足低供电电压锁相环系统对电荷泵的要求。电路采用中芯国际0．18μm标准数字工艺参数仿真。     

一种彩铃电路的设计与实现

彩铃业务是一种可以让用户自己定制回铃音的增值服务。介绍了一种使用S3C444B0和单片机以及数字交换芯片MT8980实现彩铃功能的设计思想和实现方法,给出了详细的硬件结构图和软件代码。     

一种新型正负倍压双输出电荷泵电路的设计

采用电荷泵电路实现电压倍增的原理,设计出一种新型正负倍压双输出电荷泵电路,该电路可以将＋5 V电源输入转换为广泛应用于接口电路中的±10 V电源电压,尤其适用于无法使用到±10 V电源的场合.该设计采用6μm铝栅工艺库对该电路进行了仿真,其仿真结果与理想值基本一致.     

锁相环用CMOS鉴频鉴相器及电荷泵的实现

锁相环(PLL)是一个闭环相位自动控制系统，能够利用一个精确且稳定的频率产生一系列频率准确的信号，为系统内部的其它模块提供稳定的高频时钟．鉴相器是锁相环路中不可缺少的重要组成部分，为了改善传统鉴相器捕获范围小、捕获时间长的问题，本介绍一种增加频率检测的鉴相器及电荷泵的设计方法。     

一种高性能分布式Web Crawler的设计与实现

介绍了一种大规模、高性能、分布式的Web信息搜集器的设计及其Java实现．提出了Crawler设计中数据结构、系统功能模块和相关算法新的设计思想；对设计与实现过程中需要解决的关键问题分布式协调机制、基于内存的URL存储管理等进行了讨论，并提供了现阶段的设计、实现方法和分布式无损链接分析算法．     

一种适用于低电压应用的低漏电高性能电荷泵

文章提出一种适用于低输入电压应用的新型电荷泵,电路采用一种由NMOS晶体管和小电容组合而成的电压转换开关,通过将开关的栅极连接到时钟信号以控制电荷泵各阶之间的节点电压的变化,使得电荷泵的电荷转移开关阻值降低,同时反向漏电流减小.以4阶电荷泵为例,采用SMIC 40 nm CMOS标准工艺库进行仿真以验证该结构的有效性....     

快速锁定的低功耗电荷泵锁相环

为了加快锁相环的启动速度,提出了一种初始化电路,启动完成后,初始化电路停止工作,几乎不消耗功耗。提出了动态饱和鉴相鉴频器,扩展了鉴相鉴频器的工作范围,消除了死区并且不受环境变化的影响。使用逻辑电路直接控制一个标准计数器,把脉冲吞咽计数器简化为单环路结构,节省了一个计数器,降低了功耗。采用0.18um 1.8V 1P6M N阱标准CMOS数字工艺完成设计,版图面积为0.09mm2。仿真结果表明,初始化电路和动态饱和鉴相鉴频器使得锁定时间减小了19%,而且初始频率差越大,锁定性能提高地越为显著。输出信号的相对抖动峰峰值小于1.5%,整个锁相环的功耗低于18mW。