| 深亚微米集成电路中的连线分割和缓冲器插入 |
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| 引用本文： | 白宁,林争辉.深亚微米集成电路中的连线分割和缓冲器插入[J].上海交通大学学报,2002,36(3):323-327. |
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| 作者姓名： | 白宁 林争辉 |
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| 作者单位： | 上海交通大学,大规模集成电路研究所,上海,200030 |
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| 基金项目： | 美国国家科学基金资助项目 ( 5 978East Asia andPacific Program -96 0 2 485 ) |
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| 摘 要： | 为在一定的时间限制下得到最少的缓冲器插入数目和连线分段数目，提出了一种深亚微米电路设计方法。该方法通过将传统的可变尺寸驱动连线模型改为缓冲器连线分段模型，得到了最优的缓冲器插入数目和连线分段数目。实验结果表明，在不同的时间限制下，缓冲器数目和连线分段数目是不同的。
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| 关 键 词： | 深亚微米集成电路 连线分割 缓冲器插入 |
| 文章编号： | 1006-2467(2002)03-0323-05 |
| 修稿时间： | 2001年3月26日 |
Buffer Insertion and Wire Segmenting for Deep Submicron IC |
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| BAI Ning,LIN Zheng hui.Buffer Insertion and Wire Segmenting for Deep Submicron IC[J].Journal of Shanghai Jiaotong University,2002,36(3):323-327. |
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| Authors: | BAI Ning LIN Zheng hui |
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| Abstract: | A new algorithm combined the buffer insertion and wire segmentation of VLSI design in deep submicron environment was presented. Compared with the length variable model, the wire segmentation model has the buffer driver instead, and then gets the optimized buffer number and wire segmentation result . Finally, the experiment result was analyzed. |
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| Keywords: | large scale integrated circuits buffer insertion wire segmenting emore delay |
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