| 硬件描述语言VHDL到Verilog的翻译 |
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| 引用本文： | 郭建,刘建元,杜慧敏,韩俊刚,郝克刚,华庆一.硬件描述语言VHDL到Verilog的翻译[J].西北大学学报,2000,30(1):15-19. |
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| 作者姓名： | 郭建 刘建元 杜慧敏 韩俊刚 郝克刚 华庆一 |
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| 作者单位： | 西北大学软件工程研究所!陕西西安710069(郭建，郝克刚，华庆一)，西安邮电学院ASIC中心!陕西西安710061(刘建元，杜慧敏，韩俊刚) |
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| 基金项目： | 国家自然科学基金资助项目!(69473017) |
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| 摘 要： | 分析了两种常用硬件描述语言 Verilog和 VHDL的语言特征 ,找出它们之间内在的对应关系 ,并阐述了由 VHDL向 Verilog语言翻译的实现方法。这对于硬件设计具有辅助作用
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| 关 键 词： | VHDL语言 Verilog语言 翻译程序 硬件描述语言 |
| 修稿时间： | 1999-03-01 |
Translation from VHDL to Verilog |
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| GUO Jian,LIU Jian-yuan,DU Hui-min,HAN Jun-gang,HAO Ke-gang,HUA Qing-yi.Translation from VHDL to Verilog[J].Journal of Northwest University(Natural Science Edition),2000,30(1):15-19. |
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| Authors: | GUO Jian LIU Jian-yuan DU Hui-min HAN Jun-gang HAO Ke-gang HUA Qing-yi |
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| Abstract: | An analysis is made for the characteristics of the hardware languages VHDL and Verilog languages, and the relations between them are found; the method of the translation from VHDL to Verilog is given. The hardware designing is used. |
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| Keywords: | VHDL languages Verilog languages translation |
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