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用于高速PLL的CMOS电荷泵电路
引用本文:王烜,来金梅,孙承绶,章倩苓.用于高速PLL的CMOS电荷泵电路[J].复旦学报(自然科学版),2005,44(6):929-934.
作者姓名:王烜  来金梅  孙承绶  章倩苓
作者单位:复旦大学,专用集成电路与系统国家重点实验室,上海,200433
摘    要:提出了一种应用于高速锁相环中的新型CMOS电荷泵电路.电荷泵核心部分为一带有参考电压电路的双管开关型电路,并对运放构成的反馈回路进行了改进,降低了电荷泵输出电压的抖动.电路采用chartered0.35μm 3.3 V CMOS工艺实现,模拟结果表明电流源输出电压在1~3V区间变化,其输出电流基本无变化,上下电流的失配率小于0.6%,具有很高的匹配性.在3.3V电源电压下,电荷泵输出电压的范围为0~3.1V,具有宽摆幅和低抖动(约0.2mV)等优点,能很好地满足高速锁相环的性能要求.

关 键 词:半导体技术  电荷泵  锁相环  鉴频鉴相器  压控振荡器
文章编号:0427-7104(2005)06-0929-06
收稿时间:07 7 2004 12:00AM
修稿时间:2004-07-07

A Novel CMOS Charge-Pump Circuit for High-Speed PLL Application
WANG Xuan,LAI Jin-mei,SUN Cheng-shou,ZHANG Qian-lin.A Novel CMOS Charge-Pump Circuit for High-Speed PLL Application[J].Journal of Fudan University(Natural Science),2005,44(6):929-934.
Authors:WANG Xuan  LAI Jin-mei  SUN Cheng-shou  ZHANG Qian-lin
Abstract:
Keywords:semiconductor technology  charge-pump  phase-locked loop  phase/frequency detector  voltage controlled os- cillator
本文献已被 CNKI 维普 万方数据 等数据库收录!
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