| 一种面向写穿透Cache的写合并设计及验证 |
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| 引用本文： | 梅魁志,李国辉,张斌.一种面向写穿透Cache的写合并设计及验证[J].西安交通大学学报,2010,44(4). |
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| 作者姓名： | 梅魁志 李国辉 张斌 |
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| 作者单位： | 西安交通大学人工智能与机器人研究所,710049,西安 |
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| 基金项目： | 国家自然科学青年基金，国家高技术研究发展计划资助项目 |
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| 摘 要： | 为了利用片上缓冲技术来提高处理器应用性能,提出一种面向写穿透Cache的写合并设计方法.使用同步动态随机存储器(SDRAM)的单个写方式和片上写缓冲器,对SDRAM一行内的局部数据采用写合并策略,由此提高了外部存储的访问效率,同时给出了连续和单个Cache读写的缓存与内存的数据一致性策略.在寄存器传输语言(RTL)仿真环境下使用mp3解码对Leon2处理器进行数据测试,结果表明:在缓冲区优化为3行8列的参数下,SDRAM每次行开启平均进行7.8个字的写入操作,外存的读写效率由12%提高到19%;在TSMC0.18μm工艺下,综合后面积为0.263mm2,流片后工作主频为100MHz.
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| 关 键 词： | 写穿透 写合并 处理器 同步读写存储器 读写效率 |
A Write Coalescing Design and Verification for Write-Through Cache |
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| MEI Kuizhi,LI Guohui,ZHANG Bin.A Write Coalescing Design and Verification for Write-Through Cache[J].Journal of Xi'an Jiaotong University,2010,44(4). |
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| Authors: | MEI Kuizhi LI Guohui ZHANG Bin |
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| Institution: | MEI Kuizhi,LI Guohui,ZHANG Bin(Institute of Artificial Intelligence , Robotics,Xi\'an Jiaotong University,Xi\'an 710049,China) |
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| Abstract: | A write coalescing design for write-through cache is proposed to promote the performance of application processors using on-chip buffer. The scheme of write coalition for the local data in the same row of SDRAM (synchronous dynamic random access memory) is designed to improve accessing efficiency by employing the single write mode of SDRAM and on-chip buffer. A coherence scheme for the single or multiple cache data reading or writing is also presented. Simulation for mp3 decoding data is implemented in the ... |
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| Keywords: | write through write coalescing processor synchronous dynamic random access memory access efficiency |
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