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1.
设计了一种基于外接泵电容的1.33倍新型电荷泵电路.电路采用了预启动和衬底电位选择结构,并利用三相时钟信号方式控制电荷泵的工作状态.采用0.5μmCMOS工艺模型利用Cadence的Specter工具进行了仿真.结果表明:所设计的电路提高了芯片的启动速度,有效防止了闩锁现象的产生;在典型的3.3 V输入电压下,电荷泵效率为93.25%.与传统电荷泵相比优势在于输出电压低,有效地降低了无用功耗.1.33倍电荷泵必将具有广泛地应用前景.  相似文献   
2.
设计了一种用于TFT-LCD驱动的高效率高性能电荷泵.在分析了宽输入恒输出电荷泵原理的基础上,采用跟踪输入电压动态调整升压倍率的方法,克服了传统固定倍率电荷泵的效率随输入电压升高而大幅降低的缺点.提出了简单多倍率开关阵列及控制电路,采用了改进的三管复合开关减小静态功耗.电路用0.6μm BiCMOS工艺实现.测试表明:在输入电压2.7~5.5 V,工作频率250 kHz条件下,输出电压为5 V,满载电流为25 mA,平均效率提高了14%,最低效率提高了15%,静态电流为0.1 mA,负载调整率为0.014%mA-1.  相似文献   
3.
周明 《安徽科技》2008,(3):51-52
本文介绍了一种CMOS升压开关电源控制器S-8356M50MC的主要特点和工作原理,并结合汽车电子中液晶显示屏偏置电压要求,给出了典型应用。  相似文献   
4.
在分析电荷泵锁相环结构和原理的基础上,采用符号函数sign()来描述状态变化,建立一个输入参考频率为50 MHz,输出频率为900 MHz的三阶电荷泵锁相环的事件驱动模型,通过设定模型中的参数,应用Matlab对模型进行仿真.结果表明:当输入频率为50 MHz时,此三阶电荷泵锁相环完全能够锁定,并且在锁定时,输出频率为900 MHz,达到设计目的,并且该事件驱动模型大大提高了效率.  相似文献   
5.
一种高速低相位噪声锁相环的设计   总被引:1,自引:0,他引:1  
设计了一种1.8V、SMIC0.18μm工艺的低噪声高速锁相环电路.通过采用环行压控振荡器,节省了芯片面积和成本.通过采用差分对输入形式的延时单元,很好地抑制了电源噪声.与传统的简单差分对反相器延时单元相比,该结构通过采用钳位管和正反馈管,实现了输出节点电位的快速转变,整个电路芯片测试结果表明:在输入参考频率为20MHz、电荷泵电流为40μA、带宽为100kHz时,该锁相环可稳定输出频率为7971MHz—1.272GHz的时钟信号,且在中心频率500kHz频编处相位噪声可减小至-94.3dBc/Hz。  相似文献   
6.
锁相环中低电流失配电荷泵的设计   总被引:1,自引:0,他引:1  
刘威  陈杰 《科学技术与工程》2006,6(14):2127-21282154
提出了一种应用于低供电电压低相位噪声锁相环系统的低电流失配的电荷泵电路。仿真结果表明,输出电压0.4V~1.3V范围内。电荷泵上下电流失配小于1%,满足低供电电压锁相环系统对电荷泵的要求。电路采用中芯国际0.18μm标准数字工艺参数仿真。  相似文献   
7.
电荷泵锁相环设计方法研究   总被引:7,自引:0,他引:7  
在归纳单端输出电流型电荷泵锁相环设计方法的基础上,给出单端输出电压型电荷泵锁相环的两种设计方法,直接近似为电流型输出;串接电阻为电流型输出,实验验证了其正确性从而Motorola公司设计方法的错误。  相似文献   
8.
1.8 V千兆以太网收发器低抖动时钟电路   总被引:2,自引:1,他引:1  
采用新型的高速鉴频鉴相器(TSPC)、典型的抗抖动的电荷泵和对称负载差分延迟单元,设计了0.18 μm标准CMOS工艺、1.8 V工作电压的锁相环,经过系统稳定性验证和spice仿真,125 MHz的最大时钟输出在(75℃@TT)情况下,具有±3σ=70 ps左右的long-term低抖动.同时,在3种不同工艺下施加0.1 Vpeak-peak正弦电源噪声时,对电路的工作情况进行了仿真,均能很好满足电路设计的要求(对于1000 Base-T,Δt=8 ns/16=500 ps,根据时钟恢复算法的仿真,较严格peak-peak抖动要求约为(2%~3%)×baud=160~240 ps).  相似文献   
9.
针对功率n-LDMOS器件在动态应力条件下的热载流子退化恢复效应进行了实验和理论研究.电荷泵实验测试和器件专用计算机辅助软件的仿真分析结果表明,在施加不同的动态应力条件下,功率n-LDMOS器件存在2种主要的热载流子退化机理,即鸟嘴区域的热空穴注入和沟道区域的界面态产生,均有明显的退化恢复效应.对功率n-LDMOS器件施加2个连续3 600 s的不同应力,观察每个阶段结束时刻的CP电流曲线,发现该器件在应力变换期间确实发生了热空穴的退陷阱效应.然后,对功率n-LDMOS器件施加3个连续3 600 s的不同应力,观察每个阶段结束时刻的CP电流曲线,发现器件处于关断阶段时,已产生的界面态存在一定程度的复合.  相似文献   
10.
用于高速PLL的CMOS电荷泵电路   总被引:8,自引:0,他引:8  
提出了一种应用于高速锁相环中的新型CMOS电荷泵电路.电荷泵核心部分为一带有参考电压电路的双管开关型电路,并对运放构成的反馈回路进行了改进,降低了电荷泵输出电压的抖动.电路采用chartered0.35μm 3.3 V CMOS工艺实现,模拟结果表明电流源输出电压在1~3V区间变化,其输出电流基本无变化,上下电流的失配率小于0.6%,具有很高的匹配性.在3.3V电源电压下,电荷泵输出电压的范围为0~3.1V,具有宽摆幅和低抖动(约0.2mV)等优点,能很好地满足高速锁相环的性能要求.  相似文献   
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