基于ISP器件可扩量程的数字频率计的设计

采用Lattice公司的可编程逻辑器件ispLSI 1016的设计出可扩量程的数字频率计,给出了设计过程及部分模块的电路结构。     

基于单片机和CPLD的数字频率计设计

介绍了以89552单片机和复杂可编程逻辑器件（CPLD）为核心的数字频率计的设计．利用CPLD来实现频率、周期、脉宽和占空比的测量计数;采用单片机完成测试控制、数据处理和显示输出．同时,运用等精度的设计方法,克服了基于传统测频原理的频率计的测量精度随被测信号频率的下降而降低的缺点．实验结果表明,所设计的数字频率计性能稳定、测量精度高．     

基于VHDL的数字频率计的设计

本文的数字频率计设计,采用自上向下的设计方法,实现整个电路的测试信号控制、数据运算处理和控制数码管的显示输出。一块复杂可编程逻辑器件CPLD芯片EPM7128SLC84-15完成各种时序逻辑控制、计数功能。在MAX+PLUS II平台上,用VHDL语言编程完成了CPLD的软件设计、编译、调试、仿真。本文详细论述了系统自上而下的设计方法及CPLD的软件编程设计。     

基于VHDL的数字频率计的设计

在电子设计领域．随着计算机技术、大规模集成电路技术、EDA技术的发展和可编程逻辑器件的广泛应用,传统的自下而上的数字电路设计方法、工具、器件已远远落后于当今技术的发展。基于EDA技术和硬件描述语言的自上而下的设计技术正在承担起越来越多的数字系统设计任务。本文的数字频率计设计．采用自上向下的设计方法,实现整个电路的测试信号控制、数据运算处理和控制数码管的显示输出。一块复杂可编程逻辑器件CPLD芯片EPM7128SLC84—15完成各种时序逻辑控制、计数功能。在MAX＋PLUSii平台上．用VHDL语言编程完成了CPLD的软件设计、编译、调试、仿真。CPLD芯片的现场可编程性,不但大大缩短了开发研制周期．而且使本系统具有结构紧凑、体积小．可靠性高．测频范围宽、精度高等优点。本文详细论述了系统自上而下的设计方法及CPLD的软件编程设计。     

复杂可编程逻辑器件设计中延时影响的仿真分析

为分析复杂可编程逻辑器件延时性能对数字系统设计中延时的影响规律，针对数字逻辑延时单元核的数学模型，采用硬件描述语言和图形方式实现了基本数字逻辑延时单元核，通过数字核复用建立了多延时单元部件，并运用电子设计自动化软件，通过选择不同的复杂可编程器件对延时单元进行了仿真分析、结果表明，数字逻辑设计中的延时与复杂可编程器件的延时性能、综合布局布线选择的逻辑块以及互连资源有关．所得到的结果为复杂数字逻辑系统的延时设计与分析提供了理论与实验依据．     

基于VHDL的全数字锁相环的设计

叙述了全数字锁相环的工作原理,提出了应用VHDL技术设计全数字锁相环的方法,并用复杂可编程逻辑器件CPLD予以实现,给出了系统主要模块的设计过程和仿真结果。     

可编程逻辑器件在数字电路教学改革中的应用

由于可编程逻辑器件的出版及计算机的广泛应用，数字系统的设计方法发生了根本性的变革，为适应电子技术发展的形势，数字技术数字亟需改革。本文介绍笔者通过开展可编程逻辑器件设计教学对数字技术教学改革所做的一些探索。     

可编程逻辑器件的发展概述

数字集成电路经历了从小规模集成电路(SSI)，中规模集成电路(MSI)，大规模集成电路(LSI)，和超大规模集成电路(VLSI)的发展过程。PLD器件由早期的可编程只读存储器、可编程逻辑阵列、可编程阵列逻辑、通用阵列逻辑发展到复杂可编程逻辑器件和现场可编程门阵列。PLD器件使数字系统的设计更加便利和高效，FPGA／CPLD和ASIC融合的趋势也越来越明显。     

FIR线性相位数字滤波器的CPLD实现

本文介绍了一种利用复杂可编程逻辑器件 ( CPLD) ,并采用窗函数法实现 FIR线性相位数字滤波器的设计 ,以一个十六阶 FIR带通数字滤波器说明用 FLEX1 0 K器件的设计过程 .设计的电路通过仿真测试 ,能够达到设计指标 .     

一种基于CPLD的二值数字化4DPSK解调器设计方案

针对如何用复杂可编程逻辑器件实现4DPSK信号的解调,提出了一种基于CPLD的4DPSK信号解调器设计方案.先将4DPSK信号通过双门限比较器等进行二值数字化,再用VHDL语言设计实现对此数字化后的二值逻辑信号进行延迟、相移、逻辑运算和识别等处理,实现对4DPSK信号的解调.此设计方案减小了硬件实现的复杂度,迎合了可编程逻辑器件CPLD对数字逻辑信号进行处理的特点,并给出了用可编程逻辑器件CPLD实现部分的仿真波形.     

采用ISP逻辑器件的数字系统设计方法

可编程逻辑器件是一种可以由用户在现场进行编程的逻辑器件,它给数字系统的设计带来了全新的概念,使数字系统的逻辑规模更大,设计变得更加方便、灵活和高效.本文介绍了ISP器件的结构、开发系统和设计方法.     

采用ISP逻辑器件的数字系统设计方法

可编程逻辑器件是一种可以由用户在现场进行编程的逻辑器件，它给数字系统的设计带来了全新的概念，使数字系统的逻辑规模更大，设计变得更加方便、灵活和高效。本文介绍了ISP器件的结构、开发系统和设计方法。     

基于PLD的参差脉冲周期电路的竞争冒险

数字电路中的竞争冒险是数字系统设计时必须考虑的因素，在可编程逻辑器件中，这一问题变得更加重要。针对利用可编程器件设计的参差脉冲周期电路，分析其竞争冒险产生的原因，提出了修改电路结构解决竞争冒险的办法。仿真结果证明了该方法的有效性。     

Multisim 11在可编程逻辑设计实验教学中的应用

介绍了Mu ltisim 11仿真软件的最新功能和特点,提出将其应用于可编程逻辑设计实验教学中。通过交通灯仿真电路实例证明,利用该软件可以进行可编程逻辑电路设计,并从一个可编程逻辑器件(PLD)原理图中导出原始VHDL语言,还可以将这个VDHL文件下载到现场可编程门阵列(FPGA)硬件中,从而简化通过仿真学习到的理论与真实实现的过渡。实践证明,该软件能够帮助学生理解可编程逻辑器件的工作原理,掌握可编程逻辑器件的设计和测试方法,提高自主学习的兴趣,有利于创新人才的培养,对可编程逻辑设计实验教学改革起到了积极作用。     

基于EDA技术的复杂数字电路设计

目的研究复杂数字电路在EDA开发系统上的实现方法。方法在Quartus环境下利用VHDL及原理图输入法综合设计了8位十进制数字频率计。结果下栽／配置到”在系统可编程”实验板的目标器件上,经实际电路测试验证,达到了预期的设计要求。结论与传统设计方法相比,基于EDA技术的设计方案具有外围电路简单,程序修改灵活和调试容易等特点;设计的数字频率计测量范围大,精度高,读数直观清晰。     

基于FPGA的数字锁相环的设计与实现

本文介绍了当前广泛应用的数字锁相环的原理和基于FPGA的设计与实现方法,阐明了其基本工作原理和设计思想,给出了系统主要模块的设计过程和仿真结果;用可编程逻辑器件FPGA予以实现。     

基于FPGA数据通信接口的设计与实现

随着信息化、数字化技术的不断发展,数字集成电路的应用越来越广泛,可编程逻辑器件也由早期的储存少量的数据发展到如今的超大规模复杂组合逻辑与时序逻辑的现场可编程逻辑器件,即FPGA。本文就对基于FPGA数据通信接口的设计与实现做出研究。     

基于复杂可编程逻辑器件的数字频率计的设计与实现

采用自上向下的设计方法，设计了基于复杂可编程逻辑器件的数字频率计．以AT89C51单片机作为系统的主控部件，完成电路的测试信号控制、数据运算处理、键盘扫描和控制数码管显示．用VHDL语言编程，由CPLD（Complex Programmable Logic Device）EPM7128SLC84—15完成各种时序控制及计数功能．该系统具有结构紧凑、可靠性高、测频范围宽和精度高等特点．     

CPLD在数字电压表设计中的应用

本文介绍了数字电压表的一般设计原理。并结合新型的可编程逻辑器件设计了一种方便、实用的数字电压表。     

数字逻辑技术

随着半导体技术的发展,数字逻辑电路经历了从分立元件、SSI、MSI向LSI,VLSI的演变过程．上述电路被通称为标准逻辑电路。二十世纪末标准逻辑电路开始向专用集成电路发展,推动这场历史性变革主要是可编程逻辑器件（PLD）、现场可编程门阵列（FPGA）技术的兴起,由此可编程集成电路以及与之相应的EDA技术应运而生,电子系统设计进入了一个全新的阶段。本文介绍了数字逻辑电路的发展过程,着重阐述了可编程逻辑器件、HDL语言设计方法、EDA工具设计流程及可编程片上系统技术。